Name: Herstellung von Niedertemperatur-Carbon Nanotube Vertikale Verbindungen Kompatibel mit Halbleitertechnik (Video) | JoVE Journal
Uploaded: 2015-12-07T13:00:00.000+00:00
Duration: 9 min 20 s
Description: Erfahren Sie die Herstellung vertikal ausgerichteter Kohlenstoffnanoröhren bei niedrigen Temperaturen für Halbleiteranwendungen. Diese Methode ermöglicht die Integration in integrierte Schaltkreise.

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Ein Teil der Arbeit wurde im Rahmen des Projekts JEMSiP_3D durchgeführt, das von den Behörden in Frankreich, Deutschland, Ungarn, den Niederlanden, Norwegen und Schweden sowie vom Gemeinsamen Unternehmen ENIAC finanziert wird. Die Autoren danken den Mitarbeitern des Dimes Technology Centre für die Unterstützung bei der Bearbeitung.

Achtung: Bitte beachten Sie alle relevanten Sicherheitsdatenblätter (MSDS) vor dem Gebrauch. Einige der Chemikalien in diesem Herstellungsprozess verwendet werden, sind akut giftig und krebserregend. Nanomaterialien können zusätzliche Gefahren im Vergleich zu ihren Großgegenstück haben. Bitte verwenden Sie alle geeigneten Sicherheitspraktiken bei der Arbeit mit Geräten, Chemikalien oder Nanomaterialien, einschließlich der Verwendung von technischen Massnahmen verwendet (Abzug) und persönliche Schutzausrüstung (Schutzbrille, Handschuhe, Reinraumkleidung). 1. Alignment Marker Definition zu Lithos <ol><li> Beginnen Sie mit einseitig polierten industrieller Qualität Si (100) Wafer mit entweder n oder p-Dotierung. </li><li> Mantel der Wafer mit 1,4 um von positiven Photoresist. Durchführen einer 90 sec Hexamethyldisilazan (HMDS) bei 130 ° C, um die Haftung des Photoresists, gefolgt von einem Abkühlen des Wafers auf eine kalte Platte, Spin-Beschichtung bei der entsprechenden Geschwindigkeit (3500 rpm) zu fördern, und eine 90 sec Softbake at 95 ° C. </li><li> Unter Verwendung einer Photolithographiemaske und Belichtungswerkzeug setzen die Ausrichtungsmarkierungen, Belichtungsdosis 120 mJ / cm 2. </li><li> Führen Sie eine einzelne Pfütze Entwicklungsprozess. Führen Sie eine 90 Sekunden 115 ° C Post-Exposure Bake, gefolgt von 60 Sekunden Entwicklung mit Entwickler und 90 sec Fest backen bei 100 ° C zum Aushärten des Resists. </li><li> Verwenden Sie ein Mikroskop zu untersuchen, wenn die Öffnungen in der Resist sind die richtigen Abmessungen. </li><li> Etch 120 nm von Si unter Verwendung von Chlor Plasmaätzen. Diese Dicke ergibt einen guten Kontrast für die automatische Ausrichtungssysteme der Belichtungswerkzeug in dieser Arbeit verwendet. Beispielsweise unter Verwendung eines induktiv gekoppelten Plasma (ICP): 20/40 sccm O 2 / CF 4, 5 mTorr, 60/500 W Platte / ICP HF-Leistung, 10 Sek Oxid Durchbruch Ätzen, gefolgt von 80/40 sccm Cl 2 / HBr , 60 mTorr, 20/500 W Platte / ICP HF-Leistung, 35 sec Si zu ätzen. </li><li> Verwenden Sie ein Sauerstoffplasma Stripper um den Photoresist (1 kW, 400 sccm O 2 mit endpo entfernenint Erkennung und 2 min Überätzen). Als der Photoresist durch das Plasma normaler Lösungsmittel wie Aceton gehärtet werden können, nicht verwendet werden. </li><li> Reinigen Sie die Scheiben. Legte sie zuerst für 10 min in 99% HNO 3, gefolgt von Spülen in DI-Wasser, bis der spezifische Widerstand des Wassers 5 MOhm (organisch sauber). Nach diesem Reinigen der Wafer 10 min lang in 65% HNO 3 bei 110 ° C durch Spülen mit entionisiertem Wasser und danach, bis der spezifische Widerstand des Wassers 5 MOhm (Metall sauber). Verwenden Sie einen Rinser Dryer, um die Wafer zu trocknen. </li></ol> 2. Bottom Metall- und dielektrischen Zwischenschichtabscheidung <ol><li> Verwenden Magnetronsputtern, um die untere Metallschicht des Tests via abzuscheiden. Ein Stapel von drei Metallschichten muss aufgebracht werden: 500 nm Ti, 50 nm TiN und 100 nm Ti. Die erste Ti-Schicht ist, um den Widerstand des Stapels zu verringern, ist die TiN die eigentliche Trägerschicht für CNT Wachstum und die obere Ti ist, die TiN gegen Plasmabeschädigung zu schützen, wenn das Ätzen der SiO 2 -Schicht 12 </sup&gt;. Zuführen Ti Sputtern unter Verwendung eines reinen Ti-Targets mit Ar-Plasma bei einer Substrattemperatur von 350 ° C. TiN reaktives Sputtern verwenden eine Kombination von Ar und N 2, erneut bei 350 ° C Substrattemperatur. </li><li> Unter Verwendung von Plasma-unterstützter chemischer Gasphasenabscheidung (PECVD), hinterlegt eine 1 um dicke Schicht aus SiO 2. Hier Tetraethylorthosilikat (TEOS) als Vorläufer bei einer Plattentemperatur von 350 ° C verwendet. <ol><li> Überprüfen Sie die Dicke der SiO 2 -Schicht mit einem geeigneten Werkzeug, beispielsweise einem Reflektometer oder Ellipsometer. </li></ol></li><li> Beschichten des Wafers mit 1,4 um aus positivem Photoresist, beginnend mit einem 90 sec HMDS-Behandlung bei 130 ° C, gefolgt von einem Abkühlen des Wafers auf eine kalte Platte, Spin-Beschichtung bei der entsprechenden Geschwindigkeit (3500 rpm) und einer 90 s Weich backen bei 95 ° C. </li><li> Unter Verwendung einer Photolithographiemaske und Belichtungswerkzeug, setzen Sie das gewünschte Muster von Öffnungen, die später in die SiO 2 t geätzt werdeno die Durchkontaktierungen zu den Ausrichtungsmarkierungen ausgerichtet sind, Belichtungsdosis 140 mJ / cm 2. </li><li> Führen Sie eine einzelne Pfütze Entwicklungsprozess, beginnend mit einem 90 s 115 ° C Post-Exposure Bake, gefolgt von 60 Sekunden Entwicklung mit Entwickler und 90 sec Fest backen bei 100 ° C. </li><li> Verwenden Sie ein Mikroskop zu untersuchen, wenn die Öffnungen in der Resist sind die richtigen Maße und, wenn die Überlagerung auf die Ausrichtungsmarkierungen korrekt ist. </li><li> Plasmaätzen der Kontaktöffnungen in der SiO 2. Verwenden Sie beispielsweise eine Triode Plasmaätzer mit C 2 F 6 / CHF 3 36/144 sccm bei 180 mTorr und 300 W HF-Leistung. Bei Bedarf nehmen Sie Ätzrate Tests auf einem Testwafer, um mehr zu minimieren Ätzen, um 5% -10% in der Zeit. Anmerkung: Obwohl das Ti ist beständig gegen reaktives Ätzen in dieser Fluorchemie, werden längere Exposition an das Plasma in der physikalischen Ätzung der Ti-Schicht führen. Wenn die TiN-Schicht dem Plasma ausgesetzt ist diese negativ influen habenCE mit dem Wachstum der CNT 12. Verwenden Sie keine Nassätzen, da dies zu viel Aufweitung der Öffnungen führen, so dass die obere Metallisierung teil 4 problematisch. </li><li> Entfernen Sie die Opfer Ti-Schicht durch Nassätzen in 0,55% HF für 60 Sekunden. Nach dem Ätzen der Wafer gründlich mit DI-Wasser, bis der Wasserwiderstand 5 M &amp; Omega; und mit einem Rinser Dryer, um die Wafer zu trocknen. Hinweis: Die Verwendung eines Mikroskops überprüft werden kann, wenn der Ti-Schicht geätzt werden kann, wird die TiN-Schicht eine goldbraune Farbe haben, während der Ti ist grau metallic. </li></ol> 3. Katalysator Deposition und CNT Wachstum <ol><li> Verdampfen 5 nm Co unter Verwendung einer Elektronenstrahlverdampfer. Abpumpen bis mindestens 2x10 -6 Torr und heizen die Wafer bis 60 ° C unter Verwendung von Lampen unter Vakuum vor der Abscheidung, jede Wasserfilm zu entfernen. Der Photoresist verwendet, um die Kontaktöffnungen zu definieren auf den Wafer gehalten wird, um eine Selbstausrichtung des Katalysators, der Kontaktöffnungen in der SiO 2 bereitzustellen. </li><li> Entfernendie Co außerhalb der Kontaktöffnungen durch Abheben. Für Co wurde gefunden, daß Tetrahydrofuran (THF) ergibt die besten Ergebnisse Abheben und Wachstum bei niedrigen Temperaturen. N-Methyl-2-pyrrolidon (NMP), das zuvor für Abheben nach Verdampfen Fe verwendet wurde, um eine Beschädigung festgestellt das Co auch in einem solchen Ausmaß, jede ausgerichtet CNT Wachstum zu verhindern. Gesetzt den Wafer für 15 min im Ultraschallbad mit THF bei 35 ° C. Spülen mit DI-Wasser für 5 Minuten und trocknen unter Verwendung einer Schleuder oder Stickstoff Pistole. </li><li> Untersuchen Sie den Wafer unter dem Mikroskop und überprüfen Lackreste. Wenn Rückstände bleiben führen eine längere Ultraschallbehandlung in THF und gegebenenfalls mit einem speziellen weichen Wattestäbchen für Lift-off-Zwecken manuell abzuwischen Rückstände. </li><li> Zuführen CNT Wuchses mit Niederdruck-Gasphasenabscheidung (LPCVD). Verwenden des folgenden Rezepts: 8 min vorgeGlühen bei 350 ° C mit 700 sccm H 2 bei 80 mbar, gefolgt von CNT Wachstum durch Zugabe von 50 sccm C 2 H 2. Bei 350 ° C, 60min des Wachstums gibt etwa 1 &amp; mgr; m von CNT. Falls erforderlich einen Test Wachstum zu stimmen die Höhe, die die gleiche Dicke wie der SiO 2 -Schicht sein sollte. Cool down des Reaktors und Spülen mit N 2. </li><li> Verwenden Sie ein Rasterelektronenmikroskop, um die Höhe der CNT innerhalb der Öffnungen unter 45 ° Neigung, oder durch Herstellung eines Querschnitts zu überprüfen. </li><li> Prüfen die Proben unter Verwendung von Raman-Spektroskopie, um die Kristallinität der CNT 18 bestimmen. </li></ol> 4. Topside Metallisierung <ol><li> Verwenden Magnetron-Sputtern, um die obere Metall abzuscheiden. Ti ist ein guter Metall zur Kontaktierung CNT 19 erster 100 nm Ti, gefolgt von 2 &amp; mgr; m Al (1% Si) zu sputtern, ohne das Vakuum zu brechen. </li><li> Beschichten des Wafers mit 3,1 um aus positivem Photoresist mit höherer Viskosität, beginnend mit einem 90 sec HMDS-Behandlung bei 130 ° C, gefolgt von einem Abkühlen des Wafers auf eine kalte Platte, Schleuderbeschichtung bei 3000 Upm und 90 s Weichbacken an 95° C. </li><li> Unter Verwendung einer Photolithographiemaske und Belichtungswerkzeug setzen den oberen Metallmuster auf die Ausrichtungsmarkierungen ausgerichtet ist, Belichtungsdosis 420 mJ / cm 2, Fokus -1. </li><li> Führen Sie eine einzelne Pfütze Entwicklungsprozess. Dies beginnt mit einer 90 Sek 115ºC post-exposure bake, gefolgt von 60 Sekunden Entwicklung mit Entwickler und 90 sec Fest backen bei 100 ° C. </li><li> Verwenden Sie ein Mikroskop zu untersuchen, ob die Zeilen in der zu widerstehen der korrekten Abmessungen und wenn die Überlagerung auf die Markierungen korrekt ist. </li><li> Ätzen der Ti / Al-Stack unter Verwendung von Chlor Plasmaätzen. Beispielsweise unter Verwendung eines induktiv gekoppelten Plasmas: 30/40 sccm Cl 2 / HBr, 5 mTorr, 40/500 W Platen / ICP HF-Leistung mit Endpunkterfassung und 80% Überätzen unter Verwendung von 15/30 sccm Cl 2 / HBr. </li><li> Verwenden Sie ein Sauerstoffplasma Stripper um den Photoresist (1 kW, 400 sccm O 2 mit Endpunktdetektion und 2 min Überätzen) zu entfernen. Wenn die Metallabdeckung nicht vollständig ist (das heißt, es gibt kleine Löcher in der Nähe desCNT) verwenden ein organisches Lösungsmittel (zB NMP), um den Photoresist, um Plasma-Schäden an der CNT zu verhindern, entfernen. </li><li> Reinigen Sie die Scheiben. Setzte sie 10 Minuten lang in 99% HNO 3, gefolgt von Spülen mit entionisiertem Wasser, bis der spezifische Widerstand des Wassers 5 MOhm (organische sauber). Verwenden Sie einen Rinser Dryer, um die Wafer zu trocknen. </li></ol> 5. Messungen <ol><li> Verwenden eines Rasterelektronenmikroskops gemß den Anweisungen des Herstellers, um die obere Metallisierung der Wafer zu überprüfen. . Hinweis: Bei Bedarf kann der Wafer mechanisch, um die komplette CNT über Verwendung einer Probe Neigung von 90 °, was zu Bildern überprüfen gespalten, wie in Abbildung 3 dargestellt werden, wie die Proben sind elektrisch leitfähig keine zusätzlichen Behandlungsschritte verwendet werden müssen und Die Proben können direkt in die SEM montiert werden. Im Allgemeinen können hohe Beschleunigungsspannungen von 15 bis 20 kV verwendet werden, aber wenn der SiO 2 -Schicht wird aufgeladen zu viel kann reduziert werden to 5 kV. </li><li> Zuführen 4-Punkt-Sonde IV-Messungen unter Verwendung eines Probe-Station in Kombination mit einem Halbleiter Parameteranalyser wie in Figur 1 und in Vollebregt et al. 16 beschrieben. Hinweis: Normalerweise ist ein Spannungsdurchlauf von -0,5 bis 0,5 V ausreichend, da der Spannungsabfall über einen Verbindungsidealerweise klein ist. Durch die Verwendung einer 4-Punkt-Sonde Setup der Kontaktwiderstand der Sondennadeln und den Drahtwiderstände des Setup werden weggelassen. </li></ol>

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Die Autoren haben nichts offenzulegen.

Figur 1 zeigt einen schematischen Überblick über den Aufbau in dieser Arbeit hergestellt ist, und die in dem 4-Punkt-Sondenmessungen verwendet wurde. Indem das Potential über die Sonden tragenden kein Strom gemessen wird, kann die genaue Potentialabfall (V H -V L) über dem zentralen CNT Bündels und seine Kontakte an die Metall gemessen werden. Größeren Durchmesser CNT Bündel werden verwendet, um die untere TiN-Schicht von den Kontaktflächen zu kontaktieren, um den Gesamtwiderstand ...

Kupfer und Wolfram, die Metalle, die derzeit für die Leiterbahnen in State-of-the-Art-Integrationsgrad (VLSI) Technologie verwendet werden, nähern sich ihre physikalischen Grenzen in Bezug auf Zuverlässigkeit und elektrische Leitfähigkeit 1. Während des Herunterskalierung Transistoren ihre Leistung im Allgemeinen verbessert, es tatsächlich erhöht den Widerstand und die Stromdichte der Leiterbahnen. Dies führte zu Verbindungen dominiert den integrierten Schaltkreis (IC) Leistung in Bezug auf Verzögerung und Stromverbrauch 2. Carbon Nanotubes (CNT) sind als Alternative für Cu und W-Metallisierung vorgeschlagen worden, vor allem für vertikale Verbindungen (Vias) als CNT kann leicht vertikal 3 angebaut. CNT ist gezeigt worden, ausgezeichnete elektrische Zuverlässigkeit aufweisen, so dass eine bis zu 1000-mal höheren Stromdichte als Cu 4. Hinzu kommt, dass CNT nicht von der Oberfläche und Korngrenzenstreuung zu leiden, die Erhöhung wird die resistivity von Cu im Nanometerbereich 5. Schließlich CNT wurde gezeigt, daß eine ausgezeichnete thermische Leiter 6, der im Wärmemanagement in VLSI-Chips unterstützen kann. Für eine erfolgreiche Integration von CNT in der VLSI-Technologie ist es wichtig, dass die Wachstumsprozesse für die CNT mit der Halbleiterherstellung kompatibel gemacht. Dies erfordert das Niedertemperaturwachstum von CNT (&lt;400 ° C) unter Verwendung von Materialien und Ausrüstung, die als verträglich und skalierbar Großproduktion sind. Obwohl viele Beispiele von CNT Test Durchkontaktierungen sind in der Literatur 7,8,9,10,11,12,13,14 demonstriert worden, die meisten von ihnen verwenden Fe als Katalysator, der als eine Verunreinigung in der IC-Herstellung 15 gilt. Außerdem ist die Aufwachstemperatur in vielen dieser Arbeiten verwendet viel höher als die obere Grenze von 400 ° C. Vorzugsweise CNT sollte sogar unter 350 ° C gehalten werden, um die Integration mit modernen Nieder κ-Dielektrika oder flexible ermöglichenSubstraten. Hier präsentieren wir eine skalierbare Methode zur wachsenden CNT bei Temperaturen bis zu 350 ° C unter Verwendung von Co als Katalysator 16. Diese Methode ist von Interesse für die Herstellung von verschiedenen elektrischen Strukturen, die aus vertikal ausgerichteten CNT in integrierten Schaltungen, die von Verbindungs- und Elektroden an Super-Kondensatoren und Feldemissionsvorrichtungen. Der Co-Katalysator Metall wird oft in der IC-Herstellung für die Herstellung von Silizid von 17 verwendet, während TiN ist eine häufig verwendete Sperrmaterial 7. Darüber hinaus zeigen wir ein Verfahren zur Herstellung CNT Test Vias während nur unter Verwendung von Techniken aus Standard-Halbleiterfertigung. Damit werden CNT Test Durchkontaktierungen hergestellt, durch Rasterelektronenmikroskopie (SEM) und Raman-Spektroskopie und elektrisch charakterisiert inspiziert.

<table><tbody><tr><td>Si (100) Wafer 4"</td> <td>International Wafer Service</td><td></td><td>Beständigkeit: 2-5 m&Omega;-cm, Dicke: 525 &micro; M&nbsp;</td></tr><tr><td>Ti-Sputtertarget (99,995 % Reinheit)</td><td>Praxair</td><td></td><td></td></tr><tr><td>Al (1 % Si)-Sputtertarget (99,999 % Reinheit)</td><td>Praxair</td><td></td><td></td></tr><tr><td>Co (99,95 % Reinheit)</td><td>Kurt J. Lesker</td><td></td><td></td></tr><tr><td>SPR3012 positiver Fotolack</td><td>Dow Electronic Materials</td><td></td><td></td></tr><tr><td>MF-322 Entwickler</td><td>Dow Electronic Materials</td><td></td><td></td></tr><tr><td>HNO3 (99,9%)</td><td>KMG Ultra Pure Chemicals</td><td></td><td></td></tr><tr><td>HNO3 (69,5%)</td><td>KMG Ultra Pure Chemicals</td><td></td><td></td></tr><tr><td>HF 0,55%</td><td>Honeywell</td><td></td><td></td></tr><tr><td>Tetrahydrofuran</td><td>JT Baker</td><td></td><td></td></tr><tr><td>Aceton</td><td>Sigma-Aldrich</td><td></td><td></td></tr><tr><td>ECI3027 positiver Fotolack</td><td>AZ</td><td></td><td></td></tr><tr><td>Tetraethylorthosilikat (TEOS)</td><td>Praxair</td><td></td><td></td></tr><tr><td>N2 (99,9990%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>O2 (99,9999%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>CF4 (99,9970%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>Cl2 (99,9900%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>HBr (99,9950%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>Ar (99.9990%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>C2F6 (99.9990%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>CHF3 (99.9950%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>H2 (99.9950%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>C2H2 ( 99,6000%)</td><td>Praxair</td><td></td><td></td></tr><tr><td>EVG 120 Beschichter/Entwickler</td><td>EVG</td><td></td><td></td></tr><tr><td>ASML PAS5500/80 Waferstepper</td><td>ASML</td><td></td><td></td></tr><tr><td>SPTS &Omega; mega 201 Plasmaätzer</td><td>SPTS</td><td></td><td>Wird zum Si- und Metallätzen</td></tr><tr><td>verwendet SPTS & Sigma; igma Sputter Coater</td><td>SPTS</td><td></td><td></td></tr><tr><td>Novellus Concept One PECVD</td><td>LAM</td><td></td><td></td></tr><tr><td>Drytek 384T Plasmaätzer</td><td>LAM</td><td></td><td>Wird zum Oxidätzen</td></tr><tr><td>verwendet CHA Solution Elektronenstrahlverdampfer</td><td>CHA</td><td></td><td></td></tr><tr><td>AIXTRON BlackMagic Pro CVD-Werkzeug</td><td>AIXTRON</td><td></td><td>Kohlenstoffnanoröhrenwachstum</td></tr><tr><td>Philips XL50 Rasterelektronenmikroskop</td><td>FEI</td><td></td><td></td></tr><tr><td>Tepla 300</td><td>PVA TePla</td><td></td><td>Resist Plasma-</td></tr><tr><td>Avenger Rinser Trockner</td><td>Microporcess Technologies</td><td></td><td></td></tr><tr><td>Leitz MPV-SP Reflecometer</td><td>Leitz</td><td></td><td></td></tr><tr><td>Renishaw inVia Raman Spektroskop</td><td>Renishaw</td><td></td><td></td></tr><tr><td>Agilent 4156C Parameter-Spektrumanalysator</td><td>Agilent</td><td></td><td></td></tr><tr><td>Cascade Microtech Sondenstation</td><td>Cascade Microtech</td><td></td><td></td></tr></tbody></table>

herstellung von niedertemperatur-carbon nanotube vertikale verbindungen kompatibel mit halbleitertechnik

Fabrication of Low Temperature Carbon Nanotube Vertical Interconnects Compatible with Semiconductor Technology

Wir demonstrieren eine Methode für das Tieftemperaturwachstum (350 °C) von vertikal ausgerichteten Kohlenstoffnanoröhren (CNT)-Paketen auf elektrisch leitfähigen Dünnschichten. Aufgrund der niedrigen Wachstumstemperatur ermöglicht das Verfahren die Integration mit modernen Dielektrika mit niedrigem κ und einigen flexiblen Substraten. Das Verfahren ist kompatibel mit der Standard-Halbleiterfertigung, und es wird ein Verfahren zur Herstellung von elektrischen 4-Punkt-Sondenprüfstrukturen für vertikale Verbindungsprüfstrukturen vorgestellt. Mit Hilfe der Rasterelektronenmikroskopie wird die Morphologie der CNT-Bündel untersucht, was die vertikale Ausrichtung der CNT demonstriert und zur Abstimmung der CNT-Wachstumszeit verwendet werden kann. Mit Hilfe der Raman-Spektroskopie wird die Kristallinität des CNT untersucht. Es wurde festgestellt, dass die CNT aufgrund der niedrigen Wachstumstemperatur viele Defekte aufweisen. Die elektrische Strom-Spannungs-Messung der vertikalen Testverbindungen zeigt eine lineare Antwort, was darauf hindeutet, dass ein guter ohmscher Kontakt zwischen dem CNT-Bündel und den oberen und unteren Metallelektroden erreicht wurde. Die erhaltenen Widerstände des CNT-Bündels gehören zu den Durchschnittswerten in der Literatur, wobei eine rekordniedrige CNT-Wachstumstemperatur verwendet wurde.

Die Konstruktion der Messstruktur in dieser Arbeit verwendet wird, kann in 1 gefunden werden. Durch Verwendung eines solchen Aufbaus der Messung der CNT Bündel Beständigkeit und Metall-CNT Kontaktwiderstände genau bestimmt werden kann, als Sonde und Drahtwiderstände umgangen werden. Der Widerstand des Bündels ist ein Maß für die Qualität und Dichte der CNT Bündel. Um den Kontaktwiderstand zu Bündeln unterschiedlicher Längen zu bestimmen sollte, gemessen werden. Eine typische...

Ein Verfahren für das Wachstum von vertikal ausgerichteten Kohlenstoffnanoröhren bei niedrigen Temperaturen und die anschließende Herstellung von vertikal verschalteten elektrischen Teststrukturen unter Verwendung der Halbleiterfertigung wird vorgestellt.

Herstellung von Niedertemperatur-Carbon Nanotube Vertikale Verbindungen Kompatibel mit Halbleitertechnik

We demonstrate a method for the low temperature growth (350 &#176;C) of vertically-aligned carbon nanotubes (CNT) bundles on electrically conductive ...

Das übergeordnete Ziel dieses Verfahrens besteht darin, vertikal ausgerichtete Kohlenstoffnanoröhren anzuzüchten und elektrische Teststrukturen unter Verwendung standardmäßiger Halbleitertechniken herzustellen. Diese Methode kann zentrale Fragen im Bereich der Mikro-Röntgenstrahlung beantworten, beispielsweise, ob vertikal ausgerichtete Kohlenstoffnanoröhren für Verbindungsleitungen und andere Anwendungen in integrierten Schaltkreisen eingesetzt werden können. Der Hauptvorteil dieser Technologie liegt darin, dass sie mit der standardmäßigen Halbleiterfertigung kompatibel ist und über eine ausreichend niedrige Herstellungstemperatur verfügt, die eine Integration in die CMOS-Back-End-Prozesse sowie mit bestimmten Polymeren ermöglicht.Um dieses Verfahren zu beginnen, tragen Sie die untere Metallschicht des Tests mittels Magnetronsputtern auf. Führen Sie das Sputtern von Titan unter Verwendung eines reinen Titanziels mit Argon-Plasma bei einer Substrattemperatur von 350 Grad Celsius für Titannitrid durch. Reaktives Sputtern.Verwenden Sie eine Kombination aus Argon und Stickstoff bei einer Substrattemperatur von 350 Grad Celsius, um mittels plasmaunterstützter chemischer Gasphasenabscheidung eine ein Mikrometer dicke Schicht aus Siliziumdioxid abzuscheiden. Überprüfen Sie nach Beendigung die Dicke der Siliziumdioxidschicht mithilfe eines Reflektometers. Beschichten Sie danach den Wafer mit 1,4 Mikrometern positivem Fotolack, indem Sie eine 92. Dexamethason-Behandlung bei 130 Grad Celsius durchführen, nachdem der Wafer auf einer Kühlplatte abgekühlt wurde, und anschließend bei 3.500 U/min spin-coaten. Danach den Wafer 90 Sekunden lang bei 95 Grad Celsius vorbaken, unter Verwendung einer Fotolithographiemaske und eines Belichtungsgeräts.Belichten Sie das gewünschte Muster von Öffnungen mit einer Dosis von 140 Millijoule pro Quadratzentimeter. Führen Sie danach einen einzelnen Puddle-Entwicklungsprozess durch, beginnend mit einer Nachbelichtungs-Temperung bei 115 Grad Celsius für 92 Sekunden. Anschließend führen Sie eine 62-sekündige Entwicklung mit Entwickler durch, nachdem eine Härtebehandlung bei 100 Grad Celsius für 90 Sekunden erfolgt ist.Überprüfen Sie mithilfe eines Mikroskops, ob die Öffnungen im Resist die korrekten Abmessungen aufweisen und ob die Überlagerung mit den Ausrichtungsmarkierungen stimmt. Ätzen Sie anschließend die Kontaktöffnungen im Siliziumdioxid mittels eines Triad-Plasmaätzers. Es ist sehr wichtig, dass das Titannitrit nicht dem Plasma ausgesetzt wird, da dies andernfalls das erfolgreiche Wachstum der Kohlenstoffnanoröhren verhindern würde.Entfernen Sie die opfernde Titanschicht durch nasses Ätzen in 0,55 % Wasserstofffluorid für 60 Sekunden. Spülen Sie die Wafer nach dem Ätzen mit entionisiertem Wasser, bis die Wasserwiderstandsfähigkeit fünf Megaohm beträgt. Anschließend trocknen Sie die Wafer mit einem Spültrockner.An diesem Punkt fünf Nanometer Kobalt mittels Elektronenstrahlverdampfer verdampfen, nachdem ein Vakuum von mindestens zwei mal 10 hoch minus sechs Tor erreicht wurde. Die Wafer unter Vakuum vor dem Abscheiden mit Lampen auf 60 Grad Celsius erhitzen, um eventuelle Wasserfilme zu entfernen. Das Kobalt außerhalb der Kontaktöffnungen durch Ablösen entfernen.Legen Sie den Wafer 15 Minuten lang in ein Ultraschallbad mit Tetrahydrouran bei 35 Grad Celsius. Spülen Sie anschließend fünf Minuten lang mit deionisiertem Wasser und trocknen Sie ihn mit einem Spinner. Untersuchen Sie den Wafer unter einem Mikroskop und prüfen Sie auf Reste des Lacks.Optional kann ein spezieller weicher Wattestäbchen zum Abheben verwendet werden, um Rückstände manuell zu entfernen. Falls Rückstände verbleiben, führen Sie eine längere Ultraschallbehandlung in Tetra hid Ferran Furan durch.Danach das Wachstum von Kohlenstoffnanoröhren oder CNTs mittels chemischer Gasphasenabscheidung bei niedrigem Druck durchführen. Anschließend den Reaktor abkühlen und mit Stickstoff spülen.Überprüfen Sie mithilfe eines Rasterelektronenmikroskops oder REM die Höhe der CNT innerhalb der Öffnungen bei einer Neigung von 45 Grad. Untersuchen Sie anschließend die Proben mittels Raman-Spektroskopie, um die Kristallinität der CNT zu bestimmen. Verwenden Sie Magnetronsputtern, um 100 Nanometer Titan und danach zwei Mikrometer Aluminium abzusputtern, ohne das Vakuum zu brechen.Beschichten Sie die Wafer anschließend mit 3,1 Mikrometern eines positiven Photoresists mit höherer Viskosität, beginnend mit einer 92nd-Hexaethylsilan-Behandlung bei 130 Grad Celsius, sobald die Wafer auf einer Kühlplatte abgekühlt sind. Spin-Coaten Sie bei 3000 U/min, nachdem ein weiches Backen bei 95 Grad Celsius für 90 Sekunden durchgeführt wurde. Belichten Sie das obere Metallmuster mit einer Belichtungsdosis von 420 Millijoule pro Quadratzentimeter und einem Fokus von minus eins unter Verwendung einer Photolithographiemaske und einer Belichtungsvorrichtung. Führen Sie einen einfachen Pfützenentwicklungsprozess durch, beginnend mit einem Nachbelichtungsbacken bei 92nd 115 Grad Celsius.Führen Sie anschließend eine 62. Belichtung mit Entwickler nach dem Anbacken bei 100 Grad Celsius für 90 Sekunden durch. Überprüfen Sie mithilfe eines Mikroskops, ob die Linien im Resist die korrekten Abmessungen aufweisen und ob die Überlagerung zu den Markierungen stimmt. Danach.Ätzen Sie den Titan-Aluminium-Verbund mithilfe einer Chlor-Plasmaätzung mit induktiv gekoppelter Plasmaquelle, um den Fotolack zu entfernen. Verwenden Sie einen Sauerstoff-Plasma-Abstreifer, falls die Metallbedeckung nicht vollständig ist. Verwenden Sie ein organisches Lösungsmittel wie nm Methylperon, um den Fotolack zu entfernen.Um eine Beschädigung der CNT durch Plasma zu verhindern, reinigen Sie die Wafer, indem Sie sie 10 Minuten lang in 99 %iger Salpetersäure platzieren. Spülen Sie sie anschließend mit entionisiertem Wasser ab, bis die Widerstandsfähigkeit des Wafers fünf Megaohm beträgt.Trocknen Sie die Wafer abschließend mit dem Spül- und Trockengerät. Ein typisches REM-Bild von CNT vor der Metallisierung ist hier dargestellt und nützlich, um zu überprüfen, ob die Wachstumszeit korrekt eingestellt ist, um dieselbe Länge wie die Dicke der Siliziumdioxid-Schicht zu erhalten. Ein Querschnitt, der mit REM an demselben Wafer nach der Metallisierung untersucht wurde, ist hier gezeigt und kann zur Bestimmung der Ausrichtung der CNT sowie ihrer Dichte verwendet werden.Und wenn ein Hochauflösender Rasterelektronenmikroskop (REM) verwendet wird, um ihren Durchmesser zu bestimmen, kann auch die Kontaktfläche zwischen den CNTs und den Metallschichten untersucht werden. Raman-Spektren von bei 350 Grad Celsius gewachsenen CNTs aus Kobalt werden hier dargestellt und können zur Untersuchung der Kristallinität sowie zur Optimierung der CNT-Wachstumsparameter genutzt werden, um CNTs von höchster Qualität zu erhalten. IV-Messungen wurden mithilfe von Vier-Punkt-Probe-Strukturen durchgeführt. Wenn das IV-Verhalten linear ist, weist dies auf einen ohmschen Kontakt zwischen den CNTs und den metallischen Kontakten hin.Aus dem Widerstand und den Abmessungen der Bündel kann die spezifische elektrische Widerstandsfähigkeit berechnet und nach der Entwicklung mit Literaturwerten verglichen werden. Diese Technik ebnete Forschern auf dem Gebiet der Mikroelektronik den Weg, die Anwendung von vertikal ausgerichteten Kohlenstoffnanoröhren in integrierten Schaltungen zu erforschen. Nach dem Anschauen dieses Videos sollten Sie ein gutes Verständnis dafür haben, wie man mithilfe der chemischen Gasphasenabscheidung vertikal ausgerichtete Kohlenstoffnanoröhren in Öffnungen für vertikale Durchkontaktierungen züchtet.

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Research

Forschung

JoVE Journal

Engineering

Ingenieurwesen

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Fabrication, Verdichtung, und Replica Molding von 3D-Carbon Nanotube Mikrostrukturen

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Dry Oxidation und Vakuumtempern Behandlungen für Tuning der Benetzungseigenschaften von Carbon Nanotube-Arrays

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Fabricating Nanogaps durch Nanoskiving

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